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FG Integrierte Kommunikationssysteme


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Ansprechpartner

Prof. Dr.-Ing. habil. Andreas Mitschele-Thiel

Fachgebietsleiter

Telefon +49 3677 / 69 2819

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INHALTE

Studentische Arbeiten

Thema

A Generic Debug Interface for IP-Integrated Assertions

Typ:
Diplomarbeit
Betreuer:
Dr.-Ing. Heinz- Dietrich Wuttke
Bearbeiter:
Christoph Kuznik
Status:
abgeschlossen
Abstract:
Der Entwurf von Hardware/Software Systemen ist auf eine solide Verifikationsmethodik angewiesen die den ganzen Design Flow durchzieht. Viele Konzepte haben eine Erhöhung des Abstraktionsniveau gemeinsam, wobei der modell-basierte Hardware-Entwurf einen vielversprechenden und sich verbreitenenden Ansatz darstellt. In dieser Diplomarbeit wird ein Metamodell basierter Design Flow dahingehend erweitert optional eine automatische Codegenerierung eines Interfaces für IP Assertions (silicon-debug) zu ermöglichen. Weiterhin wird ein eigenes Datenmodel entwickelt werden um die spezifischen Anforderungen an (synthetisierbare) Assertion Interfaces und die ingenieurmäßige Arbeit mit diesen Rechnung zu tragen.
Diese Diplomarbeit war Bestandteil des WP1 des Open SoC Design Platform for Reuse and Integration of IPs (SPRINT) Projektes der ESCI.