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Ansprechpartner

Prof. Dr.-Ing. habil. Andreas Mitschele-Thiel

Fachgebietsleiter

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INHALTE

Studentische Arbeiten

Thema

Testmethoden zum IP-basierten Entwurf von FPGAs

Typ:
Diplomarbeit
Betreuer:
Dr.-Ing. Heinz- Dietrich Wuttke
Raimund Ubar
Bearbeiter:
Knut Hermann
Status:
abgeschlossen
Abstract:
Die vorliegende Arbeit beschreibt einen automatisierten Ansatz für Design-for-Testability Integration in Modul-basierten digitalen Schaltungen. Dieser ermöglicht das Mitschneiden der funktionalen Testdaten, das Durchführen der Fehlersimulation sowie das anschließende Erzeugen und Einbinden von Logik zur Fehlerüberwachung in die Hardwarebeschreibung des Systems. Alternativ, falls keine ausreichende Fehlerabdeckung erzielt wurde, wird eine Fehlersimulation mit pseudozufäallig generierten Testvektoren durchgeführt. Führt diese zu einer besseren Testabdeckung, wird eine entsprechende Selbsttestlogik (BIST) in das System integriert. Der Ansatz wurde in einer Anwendung namens TTbist realisiert. Verschiedene Experimente zeigen, dass eine gute Fehlerabdeckung für arithmetische und kryptographische Schaltungen erreicht werden kann.