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Prof. Dr.-Ing. Ralf Sommer

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INHALTE

Hardwarebeschreibungssprachen, Verilog, VHDL

Verantwortlicher: Dr.-Ing. Steffen Arlt

Zielgruppen: 5. Fachsemester EIT, II, MT

Die Vorlesung findet im Wintersemester 2020/2021 ausschließlich Online statt. Die Praktikumstermine werden nach Vereinbarung vergeben.
Bitte nutzen Sie für weitere Informationen und zur Einschreibung Moodle.

Lehrinhalt

Inhalt der Vorlesung:

  • Motivation/Vorteile der Nutzung von Hardwarebeschreibungssprachen
  • Einordnung in die Designsystematik elktronischer Systeme
  • Erlernen der syntaktischen Grundelemente von VHDL und Verilog
  • Spezifische Eigenschaften von VHDL und Verilog
  • Unterschiede und Gemeinsamkeiten der beiden Hardwarebeschreibungssprachen
  • Simulation von Designs
  • Synthesegerechte Modellierung
  • Entwurfsbeispiele

Praktikumsinhalt:

  • Umsetzung einer Aufgabenstellung in VHDL oder Verilog
  • Simulation und Synthese eines Systems unter Verwendung von Xilinx Designwerkzeugen
  • Implementation auf einer FPGA Plattform