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Ansprechpartner

Prof. Dr.-Ing. habil. Andreas Mitschele-Thiel

Fachgebietsleiter

Telefon +49 3677 / 69 2819

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INHALTE

Spezielle Aspekte Integrierter Hard- und Softwaresysteme (II, IN) (ehem. IHS3)

Allgemeine Informationen


Der Termin der Auftaktveranstaltung von Herrn Rob Staals ist der 19.12. 2018. von 12:30 bis 15:30 in Raum Z 2073.
Thema: Testing and the principle of the JTAG architecture,
Gastdozent: Rob Staals, JTAG Technologies, Eindhoven, NL.

Die Teilnehmer werden zusätzlich per email über Ort und Datum informiert.

Der Übungsblock findet am 31.1. und 1.2. 2019 statt. Vortragender ist Dr. Artur Jutman von der TU Tallinn. Vorlesung: 31.1.19 10:00-12:30 Raum Z 114/115 Praktikum Raum Z 1037

  • Lab-Fehlersuche in digitalen Schaltungen, 31.1.19 von 13:30-16:45 Uhr
  • Lab-Boundary Scan 1.2.19 von 9-12:30 Uhr
  • Die weiteren Vorlesungen finden als Blockveranstaltung statt. Die Termine sind wie folgt:
    • 12.3.2019, Raum Z 2073
    • 13.3.2019, Raum Z 2073 und
    • 15.3.2019, Raum Z 2073
    • jeweils von 10:00 bis 13:00

  • Ziele der Veranstaltung

    Das Ziel der Lehrveranstaltung ist die Vermittlung von Systemwissen und Vorgehensstrategien, das den Studierenden erlaubt zentrale Entscheidungen zur Validierung von gemischten Hard- und Softwaresystemen zu treffen. Die Vorlesung zielt so auf die Befähigung von Studierenden zu einer Systemsicht, d.h. der Abstraktion von unzähligen Details des Validierungsprozesses um so das System als Ganzes verifizierbar gestalten und entwickeln zu können. Studierende sollten nach Abschluss der Lehrveranstaltung in der Lage sein, aus einer Auswahl an Validierungstechniken die für ihr Problem geeignetste auszuwählen, geeignete Methoden zur funktionalen und temporalen sowie strukturellen Validierung auszuwählen und anzuwenden und damit gezielt die nötigen Entwurfs- und Testentscheidungen im Entwicklungs- und Implementierungsprozess komplexer HW/SW-Systeme treffen zu können.

    Durchführung

    • Die Veranstaltung wird im Wintersemester angeboten
    • Stundenumfang: 1V, 2U, 0P

    Hinweis

    • Vorraussetzung ist der erfolgreiche Abschluss der Lehrveranstaltung Schaltsysteme oder vergleichbare.
    • Abschluss

      • Mündliche Prüfung: im Prüfungszeitraum 20 Minuten
      • Zeit und Ort: Die Einschreibung kann in der letzten Vorlesungswoche im Sekretariat, Zusebau, Raum 1031 bei Frau Sauer erfolgen.
  • Inhalte der Veranstaltung

  • Validierung versus Verifikation
  • Model Checking
  • Testverfahren
  • Fehlerabdeckung
  • Boundary Scan
  • Built in self Test
  • Fehlerdiagnose
  • Prüfungsschwerpunkte

    • Die Prüfungen finden im Prüfungszeitraum statt. Einschreiblisten zur Terminfestlegung liegen rechtzeitig im Sekretariat Z1031 aus. Eine Anmeldung im Prüfungsamt ist unabhängig davon vorzunehmen.
  • Validierung versus Verifikation
  • Model Checking
  • Testverfahren
  • Fehlerabdeckung
  • Boundary Scan
  • Built in self Test
  • Fehlerdiagnose
  • Arbeitsmaterialien

    • Vortrag Rob Staals, JTAG Technologies, Eindhoven, NL Download PDF
    Foliensatz 2016/17
    • IHS_3_V1 Download PDF
    • IHS_3_V2 Download PDF
    • IHS_3_V3 Download PDF
    • IHS_3_V4 Download PDF
    • IHS_3_V5 Download PDF
    • IHS_3_V6 Download PDF
    Prüfungsfragen zum Foliensatz
    • Prüfungsfragen IHS3 Download PDF
    Folien zum Laborpraktikum DR. Jutman, TU Tallinn
    • Laborpraktikum Test Digitaler Systeme Download PDF

    Literaturempfehlungen

    • S.Mourad, Y.Zorian. Principles of Testing Electronic Systems. J.Wiley & Sons, Inc. New York, 2000, 420 p.
    • A.L.Crouch. Design for Test. Prentice Hall, 1999, 349 p.
    • Tutorial about testing (TU Tallinn)